Page 501 - 완) I MDP 프로젝트 작품 보고서(전체과 1학년)1.6
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인천전자마이스터고 전자회로설계과
end
end
// 1/10분주 회로
always @(posedge clk, negedge reset)
begin
if(!reset)
begin
clk_div <= 0;
clk_div_cnt<=0;
end
else
begin
if(clk_div_cnt>=5400000)
begin
clk_div <= 1;
clk_div_cnt <= 0;
end
else
begin
clk_div_cnt <= clk_div_cnt+1;
clk_div <= 0;
end
end
end
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